S912XEG128W1MAA NXP
| 이용할 수 있는 |
S912XEG128W1MAA NXP
• 글로벌 8MB 메모리 주소 공간을 지원하는 페이징 기능
• 마스터 CPU, BDM 및 XGATE 간의 버스 중재
• 서로 다른 리소스1(내부, 외부 및 주변 장치)에 대한 동시 액세스(그림 3-1 참조)
• 타겟 버스 접근 충돌 해결
• MCU 작동 모드 제어
• MCU 보안 제어
• 각 마스터 CPU, BDM 및 XGATE에 대한 별도의 메모리 맵 스키마
• 온칩 FLASH 또는 ROM 선택을 가능하게 하는 ROM 제어 비트
• 포트 교체 레지스터 출입 통제
• CPU가 단일 칩 모드에서 구현되지 않은 주소(즉, 온칩 모듈에 속하지 않는 주소)에 액세스할 때 시스템 리셋 생성
• 글로벌 8MB 메모리 주소 공간을 지원하는 페이징 기능
• 마스터 CPU, BDM 및 XGATE 간의 버스 중재
• 서로 다른 리소스1(내부, 외부 및 주변 장치)에 대한 동시 액세스(그림 3-1 참조)
• 타겟 버스 접근 충돌 해결
• MCU 작동 모드 제어
• MCU 보안 제어
• 각 마스터 CPU, BDM 및 XGATE에 대한 별도의 메모리 맵 스키마
• 온칩 FLASH 또는 ROM 선택을 가능하게 하는 ROM 제어 비트
• 포트 교체 레지스터 출입 통제
• CPU가 단일 칩 모드에서 구현되지 않은 주소(즉, 온칩 모듈에 속하지 않는 주소)에 액세스할 때 시스템 리셋 생성
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